双方的合作将加快基于Speedster7t FPGA和Speedcore eFPGA IP的解决方案的开发
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摘要:IEEE1394串行总线以其高速实时性的特点和灵活可配置的拓扑结构为提高系统,性能提供了一种有效的途径。文中介绍了IEEEStd1394b总线系统的功能和特点,并以FPGA和DSP为控制核心设计了1394b双向数据总线传输系统,最后阐述了系统的硬件设计、工作流程以及总线的配置过程。
新工具套件增强了PolarFire FPGA在边缘计算系统中进行硬件加速的用途
摘要:给出了一种基于FPGA的生命探测信号处理系统的设计方法。从理论上研究了生命探测仪的算法及其软硬件系统。其中在FPGA软件设计中利用模块化的思想方法分别设计了FIR滤波器、异步FIFO、UART、电池监控、功能控制等功能模块。最后完成人体特征信号和体动信号的分析与提取,实现了非接触情况下生命探测与发现。相对于传统的生命探测仪,该设备具有体积小,功耗低,操作简单,携带方便等优点,特别适用于野外和战场生命探测等应用场合。
摘要:针对MPEG4格式压缩的视频数据,给出了采用NANDFLASH为存储介质,以FPGA为存储阵列的控制器,并用DSP作为数据处理的核心单元,来完成大容量视频数据存储的系统设计方法,同时对坏块的检测处理等关键问题提出了解决方案。
摘要:给出了使用verilogHDL语言对锁相环进行基于FPGA的全数字系统设计,以及对其性能进行分析和计算机仿真的具体方法。该方法采用综合仿真工具QuartusU8.0来对数字锁相环进行输入设计、功能时序仿真及器件编程。仿真结果表明:该方法可通过在传统数字锁相环基本结构的基础上增加自动变模控制模块来有效解决缩短捕捉时间和减小同步误差之间的矛盾。
摘 要:针对Altera SoC FPGA平台的Linux环境下ARM核与FPGA逻辑之间的数据交换问题,提出了一种简单有效的异步接口实现方案。该方案在轻量级总线桥上挂载Avalon 三态控制器,并通过Linux应用程序读写控制器对应的地址,从而实现ARM核与FPGA逻辑间数据的异步交换。实验结果表明,该方案能够稳定、正确、快速地读写数据,可达到预期目标。
摘要:VerilogHDL硬件描述语言是在用途最广泛的C语言的基础上发展起来的一种硬件描述语言,具有灵活性高、易学易用等特点。VerilogHDL可以在较短的时间内学习和掌握,FPGA的VeilogHDL基础语法总结,看完这些,FPGA的基本语法应该就没啥问题了!一、基础知识1、...
这是一个视频课程,每个目录序号包含3节课程,共10*3=30节视频课程,平均每节课40多分钟。目前已经全部更新完成,适合你对雷达基础知识的软硬件进行一个较为系统的学习。本课程前期是基础理论的讲解,后期是结合经验和项目实践提炼的主要内容,围绕抗干扰和工程实现进行原理阐述,省去了复杂...
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FPGA(Field-ProgrammableGateArray),即现场可编程门阵列,它是在PAL、GAL、CPLD等可编程器件的基础上进一步发展的产物。它是作为专用集成电路(ASIC)领域中的一种半定制电路而出现的,既解决了定制电路的不足,又克服了原有可编程器件门电路数有限的...
学习嵌入式需要了解硬件知识,其中包括单片机、ARM、FPGA等,不同的硬件有不同的特点,需要了解他们相应的特点才有利于操作应用。那么单片机、ARM、FPGA、嵌入式的区别和特点有哪些呢?单片机1、受集成度限制,片内存储器容量较小,一般内ROM:8KB以下;2、内RAM:256KB...
摘要:为了解决软件无线电应用中高频处理信号的大带宽信号采集和处理问题,给出了一种在FPGA数据采集系统中采用高速A/D转换芯片ADC08D500来对宽带、高频信号进行实时采样和转换的设计方案以及实验结果,该方案采用模块化设计,设计简单,通用性强,可用于高速系统中的实时数据采集和处理。
赛灵思FPGA平台出色的性能和简洁易用的 Vivado™开发工具,助力小鸟科技将业界领先的专业音视频解决方案性能提升1.5倍,并提前半年推向市场
为了提升计算基础设施的性能,并紧跟数据分析与 AI 不断攀升的需求,众多企业将硬件加速视为主要的解决方案。在大多数情况下,先进的可编程硬件是加速的主要方式。
Microchip全新低密度PolarFireÒ器件静态功耗是同类器件的一半,同时提供全球最小的发热区域
摘要:针对工业控制领域中对多串口通信的需求,采用SOPC技术并利用FPGA的可编程性,给出了一个基于NiosII的30路串口数据转发通信处理机的设计方法,同时定义了相应的数据通信协议,从而实现了30路下位机与上位机的串口通信。实验结果表明,该系统具有相对较高的可靠性和稳定性,并可以根据实际需求灵活改变串口个数,具有良好的可移植性、易实现性和灵活性。
摘要:介绍了石油测井行业的三总线接口和双相码接口原理,给出了采用C8051F500处理器和FPGA来设计 CCB测试盒的实现方法,该CCB测试盒以MCU为核心,并通过FPGA来进行逻辑控制通信的编解码。因而人机界 面友好,成本低,升级更新方便,并具有很大的灵活性。
摘要:给出了采用EDA软件Quartus II中的SOPC Builder来构建SOPC系统,再通过所构建的SOPC系统为平 台,在Altera公司的FPGA多媒体开发平台DE2上来设计物联网数字钟的具体方法。