串行加法器

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基于VHDL逻辑电路设计与应用

随着集成电路技术的高速发展，VHDL已成为设计数字硬件时常用的一种重要手段。介绍EDA技术及VHDL语言特点，以串行加法器为例，分析串行加法器的工作原理，提出了一种基于VHDL语言的加法器设计思路，给出串行加法器VHDL源代码，并在MAX+PLUSII软件上进行仿真通过。

电子设计自动化
2017-08-09

EDA vhdl 串行加法器