近日,MathWorks发布了DL Verifier中的新功能,用来加快 FPGA 在环(FIL)验证,利用新的功能,可以更快地与 FPGA 板通信,实现更高的仿真时钟频率
MathWorks今日发布了HDL Verifier中的新功能,用来加快 FPGA 在环(FIL)验证。利用新的 FIL 功能,可以更快地与 FPGA 板通信,实现更高的仿真时钟频率。
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