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  • Synopsys基于FPGA的原型验证系统亮点解读

    新思科技公司(Synopsys, Inc.)日前宣布:该公司推出其Synopsys HAPS®-70系列基于FPGA的原型验证系统,从而扩展了其HAPS产品线以应对系统级芯片(SoC)设计的不断增加的规模及复杂度。 Synopsys HAPS®-70系列基于FPGA的原型验证系统的亮点 · 借助增强型HapsTrak 3 I/O连接器技术以及高速时域多路复用技术,使系统性能提升高达3倍 · 模块化系统架构可覆盖从1200万到1.44亿个专用集成电路门,以适用于从单个IP单元到处理器子系统再到完整SoC的各种规模的设计 · Synopsys Certify®软件中的新功能与HAPS灵活的互连架构相结合,将多FPGA分区的产能加速高达10倍 · 增强的UMR总线(Universal Multi-Resource Bus)带宽高达400MB/s,有助于提升纠错的能力,并与Synopsys的Virtualizer工具一起,提升混合原型验证的性能。 · 经过预先验证的Synopsys DesignWare® IP与HAPS系统一起可确保IP单元的高效集成和更早的软件开发 HAPS-70系统提供了紧密集成的原型验证软件和硬件,包括高速时域多路复用(HSTDM)技术,它与新的HapsTrak 3 I/O连接器相结合可提供比传统的连接器和引脚复用技术高出可达3倍的原型性能改进。 此款新的原型系统利用了一个可扩展的架构以及最新一代的赛灵思Virtex-7 FPGA器件,以支持范围广泛的、各种大小的设计,其容量可从1200万到1.44亿个专用集成电路(ASIC)门。Virtex-7’s I/O bank和HapsTrak 3连接器之间的灵活性及匹配的引脚连接,使HAPS用户能够将I/O带宽用在最需要的地方,同时使未用管脚的数量减至最少。 “Virtex-7 2000T FPGA的堆叠硅片互联技术可提供两百万个逻辑单元的容量以及12.5 Gb/s的串行收发器,使其可以理想地被用于需要大容量和高速I/O的ASIC原型,”赛灵思FPGA平台市场营销副总裁Tim Erjavec说道。“Synopsys的HAPS-70系列利用了Virtex-7 2000T FPGA增大的设计容量和I/O bank结构,提供了一种可以在FPGA内部和多个FPGA之间简化设计规划的系统,同时使HAPS-70可以扩展到支持数百万ASIC门的SoC设计。” HAPS-70系统与一种智能原型验证软件环境集成在一起,可实现更快速地分区以及自动地为各种规模设计进行原型生成和纠错,包括从单个的IP单元和处理器子系统再到完整的SoC,从而简化了从RTL到可运行原型的途径。HAPS-70系统的模块化架构使工程师能够使用通用的原型环境来进行IP和SoC软件开发、软/硬件集成和系统验证,从而减少了不同项目间的重复工作量。 Synopsys的Certify多FPGA原型验证软件的全新“HAPS感知”功能借助正在申请专利的算法可将原型验证生产力提高10倍,该功能自动进行逻辑分区和现场硬件查询,与手动的分区方法相比简化了系统的形成。 此款新的原型验证系统还支持HAPS深度追踪纠错(HAPS Deep Trace Debug)功能以实现更高的纠错效率,与FPGA片上型逻辑纠错器上使用的传统存储器相比,存储容量提升了将近100倍。 为了实现更容易的系统验证和软件开发,诸如USB 3.0、PCI Express®和HDMI 那样的DesignWare接口IP都在HAPS系统上已经进行了验证。凭借在HAPS系统上经过预先验证的DesignWare IP以及用于通用IP协议的子卡的丰富可选性,设计师可以在产品开发周期中能够更早地着手软件开发,并且减少了IP集成的工作量。 “Synopsys 的HAPS基于FPGA的原型验证解决方案,在加速我们的硬件/软件验证以及提高我们的原型验证产能方面,对Mindspeed起到了不可估量的作用,”敏迅科技(Mindspeed Technologies)公司VLSI Core Engineering执行总监Surinder Dhaliwal说道。“由于我们在不断地开发基础设施产品解决方案,因此我们很高兴Synopsys已经针对像我们产品那样更大规模、更复杂设计加强了其基于FPGA的原型验证系列,使它们具有更高性能、更大容量以及改善的纠错可见度。” Synopsys的针对HAPS-70系统的UMRBus功能已被加强,可支持高达400 MB/s的带宽。UMRBus在HAPS-70系统和Synopsys的基于Virtualizer的虚拟原型之间提供了无缝连接,为早期的软件开发和软/硬件集成创造了一个集成化混合原型验证环境。UMRBus还可提供远程访问,通用的C++/TCL编程接口, 与Synopsys的VCS®功能验证解决方案一起进行co-simulation, 该 co-simulation 使层次化的模块级启动与纠错成为可能,UMRBUS的这些特性使HAPS-70系统可以更早地被纳入到设计流程。 “日益增长的设计规模、软件复杂度和尽可能早的软件开发都成为了SoC原型设计师的关键挑战,” Synopsys IP与系统市场营销副总裁John Koeter说道。“通过提供业界领先的、基于 FPGA的原型容量和性能,以及借助智能分区和纠错工具,HAPS-70系统所扩展的功能进一步缩短了软件开发和软/硬件集成的时间。通过发挥我们全面的硬件、软件和IP技术领先性,设计师们在验证他们最大规模的芯片设计时会立显成效。” 供货资源 HAPS-70基于FPGA的原型验证系统现已可向早期采用者提供9种型号的产品系列,容量从1200万到1.44亿个ASIC门:HAPS-70 S12、HAPS-70 S24、HAPS-70 S36、HAPS-70 S48、HAPS-70 S60、HAPS-70 S72、HAPS-70 S96、HAPS-70 S120和HAPS-70 S144,其中S是指可支持的ASIC门数。 HAPS-70基于FPGA的原型解决方案将参加“2012嵌入式技术/电子设计解决方案展览会”:Synopsys将在嵌入式技术/电子设计解决方案展览会上展示其运行于HAPS-70硬件上的最新基于FPGA的原型验证解决方案,展位号:# D-35。ET / EDS展览会于2012年11月14日-16日在日本横滨举办。

    时间:2012-11-19 关键词: FPGA synopsys 原型验证系统

  • 基于原型验证系统的高清视频编解码样例设计

    标签:高清视频  编解码 日前,北京亚科鸿禹电子有限公司发布一套基于其最新研发的原型验证系统“VeriTiger-DH2000T” 的应用设计。将高清视频采集,H.264数据压缩,H.264数据解压缩,1080P/60Hz视频显示等设计模块,集成至一块FPGA芯片内。结合亚科鸿禹自己研发的“Prototype Wizard”调试助手,极大地简化了SOC设计中的逻辑分割;模块划分;高速率大吞吐量的数据传输带来的设计复杂度。 数字高清视频编解码和视频处理样例系统,是基于ARM公司的标准ARM11处理器,外接标准500Mega 高清sensor采集卡,SAAIF视频处理芯片,H.264编解码IP,高清视频输出IP。实现实时的1080P/30Hz 的高清数据采集,压缩,传输,显示处理。亚科鸿禹能够提供一整套基于此设计的演示方案。 图一:高清视频压缩/解压缩显示方案结构图 随着IC制造工艺的进一步提升,高密度,高集成度的多媒体处理芯片层出不穷。我们研究分析了目前的市场上的大多数多媒体处理芯片,一般都是采用双核Cortex A8(甚至4核)+ 多2D /3D GPU+ 1080P VP8+VoIP+ATSC-T/MH的解决方案,这样一来,为在芯片设计的原型验证阶段带来了极大的挑战。众所周知目前市场上的原型验证解决方案,一般都是集成多颗FPGA,多颗FPGA之间采用模块分割的方法来解决单颗验证容量过低的问题。这样一来,模块划分和逻辑调试会为设计引入极大地挑战。因此,一款单颗高容量的原型验证系统就变的非常迫切。亚科鸿禹公司从2010年开始就投入大量设计资源,开发了针对Xilinx公司的XC7V2000T的解决方案VeriTiger-DH2000T。 VeriTiger-DH2000T的原型验证系统是基于目前单颗ASIC容量最高的FPGA芯片(XC7V2000T)的原型验证方案,可提供4Million 的ASIC设计资源。同时,板上集成PCI-eX8 接口,SATA接口,QSFP光口模块,大量的SMA接口,以利于用户实现高速串行数据应用方案。同时,整合的高性能,低抖动时钟解决方案可提供20Mhz~200Mhz的输入全局时钟,HSPI接口的可扩展IO为用户提供1320个通用IO,546个片间互联IO可以满足您逻辑扩展的需求。板载千兆以太网方案,为您实现高速PC互联提供可用资源。 图二:VeriTiger-DH2000T系统结构图 PrototypeWizard 软件,是2012年亚科鸿禹推出的原型验证调试工具。通过USB接口与计算机互联,可以为用户实现:下载配置;HYBUS总线调试;IO自测试功能;串行端口调试功能;时钟管理;电源管理;SD卡配置管理;板级温度检测的功能。 图三: PrototypeWizard界面结构。 亚科鸿禹电子有限公司,通过10年的SOC/IC设计行业的服务经验,可以为您提供整套的基于FPGA的SOC/IC 设计服务方案,为您减少产品上市时间,降低验证风险提供有力的帮助。 关于“VeriTiger-DH2000T”和“数字高清视频编解码和视频处理样例系统”详细解决方案,请联系亚科鸿禹驻当地销售和客户支持部门。

    时间:2012-08-08 关键词: 编解码 高清视频 原型验证系统

  • S2C为Xilinx原型验证系统提供突破性验证模块技术

    21ic讯 S2C 日前宣布其Verification Module技术(专利申请中)已可用于其基于Xilinx的FPGA原型验证系统中。V6 TAI Verification Module可以实现在FPGA原型验证环境和用户验证环境之间高速海量数据传输。用户可以使用Xilinx ChipScope或者第三方调试环境,同时查看4个FPGA。另外,V6 TAI Verification Module还可以用于1.3M~4.7M ASIC门的原型设计。V6 TAI Verification Module具有PCIe Gen2、千兆串行收发器、SATA2和USB 3.0等高速接口。 S2C的董事长及首席技术官Mon-Ren Chene先生说:“我们在今年6月份首次发布的Verification module技术是为使用Xilinx原型验证系统的客户提供的技术。这是一种可以将用户的FPGA原型环境和用户验证环境接口的突破性技术。由于设计通 常被分割到多个FPGA中,用户可以有这项新能力同时对多个FPGA进行调试对他们来说非常重要。FPGA原型验证系统以系统速度或者接近系统速度运行。 通过高速接口,FPGA原型验证环境可以更容易地连接到实际目标系统环境。” 三种运行模式 通用的S2C V6 TAI Verification Module提供了三种使用模式:验证模式、调试模式和逻辑模式。 验证模式使用SCE-MI或定制的C-API通过一条 x4-lane PCIe Gen2通道实现海量数据和PC之间的传输。在调试模式中,V6 TAI Verification Module通过使用Xilinx ChipScope或者其它第三方工具从而实现了多个FPGA的同步调试且同时保持用户的RTL名。在逻辑模式中,用户可以原型化一个设计,其容量能达到 4.7M门。 所有对Verification Module的调试和验证设置都是在S2C 的TAI Player Pro™中完成。 验证模式 验证模式利用TAI Verification Module的高速PCIe Gen2接口将大量仿真数据在PC和TAI Logic Module之间进行双向快速地传输。该模式能将原型系统和仿真器直接连接进行同步仿真。用户可以利用下图所示的S2C提供的定制C-API或者符合行业 标准的SCE-MI接口:   调试模式 调试模式则利用了用户现有的Xilinx ChipScope或者其它第三方调试环境。V6 TAI Verification Module从Logic Module中的多个FPGA获取用户定义的信号并接收到V6 TAI Verification Module,通过JTAG接口与ChipScope连接。 V6 TAI Verification Module 使用Xilinx ChipScope Analyzer可同时对放在两块Dual V6 TAI Logic Module上的FPGA设计进行调试。   最高能见度 每个Virtex 6 FPGA的120信号都接到了V6 TAI Verification Module的FPGA中。用户能在4 个V6 FPGA中进行120 x N信号的路径选择。最初的发布中,N固定在4上,但今后将由用户定义。用户所需要做的是在设计综合前在RTL级选择Probes并且将它们按照每个 FPGA120个probe来进行分组。S2C的TAI Player Pro自动采用多路复用技术将来自多个FPGA的调试信号发送至V6 TAI Verification Module的单个Xilinx ChipScope,并保留RTL名。将使用Xilinx ChipScope调试过程中的调试数据存储在V6 TAI Verification Module的存储器中直到满足预先设置的触发条件为止,再将这些调试数据读取出来。 逻辑模块 V6 TAI Verification Module可以作为单个原型板,为高达4.7M门容量的小规模SoC或ASIC设计使用。V6 TAI Verification Module可以配备Xilinx LX130T、LX365T 或者SX475T FPGA上,而且在4个LM连接器上共有480个外部I/O,x4 PCIe Gen2接口,4路通过SMA连接器的千兆串行收发器、一个SATA2接口以及一个USB3.0 PHY接口。 配置详情显示在下表:   可用性 V6 TAI Verification Module硬件现已供使用。  

    时间:2011-09-19 关键词: Xilinx s2c 模块技术 原型验证系统

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