
在VHDL的设计中,最常用的方法就是将数字系统的整体逐步分解为各个子系统和模块,若子系统规模较大,则还需将子系统进一步分解为更小的子系统和模块,层层分解,直至整个系统中各子系统关系合理,并便于逻辑电路级的
引 言 DevICeNet是一种基于CAN总线技术的符合全球工业标准的开放型现场总线通信网络,它用于控制,配置和数据采集等方面。CAN 总线具有布线简单、典型的总线型结构、稳定可靠、实时、抗干扰能力强、
在ARM芯片AT91RM9200上构建了无线打印模块的硬件平台,在Android操作系统上完成了软件平台的搭建,通过调用Linux内核的CUPS,实现移动终端在Android系统上直接打印文件的功能。 Android作为基于Linux
为了适应嵌入式设备外设的多样性,本文以特殊矩阵键盘为例,设计了一套完整的驱动控制模块。硬件电路设计采用外扩3片SN74HC 164芯片的方式,节省了GPIO引脚的使用,大大提高了利用效率。同时,在此基
在系统越来越复杂,功能越来越强大的今天,嵌入式系统的设计中采用实时多任务操作系统已经成为嵌入式应用设计的主流。μCOS-II是一个开源嵌入式实时操作系统(Real Time Operating System, RTOS),它已
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A/D转换控制模块ADZHKZ主要实现对ADC0809进行模数转换的控制和转换后数据的BCD转换处理。 1.ADC08O9模数转换的控制 ADC0809是CM0S的8位A/D转换器,片内有8路模拟开关,可控制8个模拟量中的一个进入转换器中。ADC080
A/D转换控制模块ADZHKZ的VHDL源程序 来源:ks990次
数据运算与处理模块SJYSCL的VHDL源程序 来源:ks990次
D/A转换控制模块DAZHKZ的VHDL源程序 来源:ks990次
键盘输入与数据显示控制模块JPXSKZ的VHDL源程序 来源:ks990次
分频模块FINI:其功能为对外部输入时钟进行分频,得到周期为1.5 ms计数器,并根据反馈信号TIME_S对计时器进行清零。其输入输出接口如图1所示,图中的CLKIN为外部时钟输入,TIME_S为定时器清零信号。 如图 分频模块F
安捷伦(Agilent)科技公司日前宣布推出一款设计流程综合解决方案,其中包括用于射频模块设计的全3D EM仿真功能。这款名为EMDS-for-ADS的全3D电磁(EM)仿真器已被集成到安捷伦的先进设计系统EDA软件平台中,从而无需使用
C281x DSP上的ADC模块将外部的模拟信号转换为数字量,通过转换控制信号进行滤波或者实现运动系统的闭环控制。尤其是在电机控制系统当中,采用ADO模块采集电机的电流或电压可以实现电机的电流环闭环控制。 ●lO位分辨