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利用锁相时钟抑制串模干扰
目前广泛使用的3 1/2~5 1/2位数字电压表（DVM），大多选用双积分式或多重积分式单片A/D转换器。其优点是电路简单，抗串模干扰能力强，成本较低。只要设计的时钟频率F0恰好等于50HZ的整倍数，电网串模干扰就被完全抑制
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DSP的电磁兼容性问题探讨
1 引言 自从20世纪80年代初期第一片数字信号处理器芯片（DSP）问世以来，DSP就以数字器件特有的稳定性、可重复性、可大规模集成、特别是可编程性和易于实现自适应处理等特点，给数字信号处理的发展带来了巨大
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DSP的电磁兼容性问题探讨
1 引言 自从20世纪80年代初期第一片数字信号处理器芯片（DSP）问世以来，DSP就以数字器件特有的稳定性、可重复性、可大规模集成、特别是可编程性和易于实现自适应处理等特点，给数字信号处理的发展带来了巨大
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利用数据线中的共模扼流圈(CMC)提高电磁兼容性
近年来，汽车内的电子设备比例在显著增长。这一趋势的发展使更多功能加入进来，用以提高汽车的安全性、效率、可靠性和便利性，并降低排放。与此相对应的便是针对总线系统提出的日益增加的要求：确保在最多样化的控
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高速DSP系统的电路板级电磁兼容性设计
随着高速DSP技术的广泛应用，相应的高速DSP的PCB设计就显得十分重要。由于DSP是一个相当复杂、种类繁多并有许多分系统的数、模混合系统，所以来自外部的电磁辐射以及内部元器件之间、分系统之间和各传输通道间的串
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高速DSP系统的电路板级电磁兼容性设计
高速DSP系统的电路板级电磁兼容性设计
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高速DSP系统的电路板级电磁兼容性设计
针对实际应用DSE系统时常见的电源干扰、传输线效应和强电干扰等问题，对电子产品电磁环境进行分析，根据电磁干扰产生的机理和影响，对DSP系统提出了电磁兼容性设计要求。从元器件的布置，地线和电源线的布置，信号线的布置三个方面给出电路板的设计方法，从而有效降低DSP系统的干扰，提高电磁兼容性能。这些技术从设计层次上保证了高速DSP系统的有效性和可靠性。
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建设电磁兼容实验室可量力而行
随着电磁兼容受关注程度不断提高，越来越多的企业开始投身于电磁兼容的研究，有的企业更是不惜花巨资成立自己的EMC(电磁兼容)实验室。日前，日本村田公司在位于上海的电磁兼容实验中心开始投入使用。业内人士认为，有
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高速数字电路的信号完整性与电磁兼容性设计
摘要：在现代高速数字电路设计中，信号完整性和电磁兼容性是设计中非常重要的问题。只有很好地控制串扰、地弹、振铃、阻抗匹配、退耦等电磁兼容因素，才能设计出成功的电路。模拟电路原理在高速数字电路设计的分析和
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怎样才能实现电磁兼容（EMC）呢
这要从分析形成电磁干扰后果的基本要素出发。由电磁骚扰源发射的电磁能量，经过耦合途径传输到敏感设备，这个过程称为电磁干扰效应。因此，形成电磁干扰后果必须具备三个基本要素：e3h安规与电磁兼容网1、电磁骚扰
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TMS320C6201高速电路PCB及电磁兼容性设计
印刷电路板(PCB)是电子产品中电路元器件的支撑件，它提供电路元器件之间的电气连接. 随着电子技术的飞速发展，目前高速集成电路的信号切换时间已经小于1ns，时钟频率已达到几百MHz，PCB的密度也越来越高。PCB设计的
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TMS320C6201高速电路PCB及电磁兼容性设计
TMS320C6201高速电路PCB及电磁兼容性设计
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莱尔德工程师获认可参与IEEE 1302标准
莱尔德科技公司近日宣布其电磁兼容性技术代表之一，美国国家无线电与电信工程师协会认证的电磁兼容性（EMC）和静电放电(ESD)工程师Gary Fenical已获认可参与共同开发用于频率范围为直流18赫兹的导电衬垫电磁特性IEEE
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运营商WCDMA终端测试体系研究
从目前国内WCDMA终端的入网测试情况来看，其测试范围并不能完全满足WCDMA运营商对终端的使用需求。WCDMA运营商还必须根据自身 WCDMA业务的发展需求，具体规定对WCDMA终端的技术要求和定制需求，通过制定合理的测试规
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嵌入式系统的电磁兼容性设计
嵌入式系统的电磁兼容性设计
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射频电路印刷电路板的电磁兼容性设计
介绍采用Protel99 SE进行射频电路PCB设计的流程。为保证电路性能，在进行射频电路PCB设计时应考虑电磁兼容性，因而重点讨论元器件的布线原则来达到电磁兼容的目的
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基于LinkSwitch的电磁兼容性设计
分析了LinkSwitch单片电源中电磁噪声的产生途径，给出了共模、差模干扰的传播途径，对不同的干扰源提出了相应的抑制方案，并重新设计了输入侧EMI滤波器。经过仿真测试证实了所提出的电磁干扰抑制方案的有效性。
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