FPGA
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Xilinx FPGA抗辐射设计技术研究
摘要：针对Xilinx FPGA在航天应用中的可行性，文章分析了Xilinx FPGA的结构以及空间辐射效应对FPGA的影响，结合实际工程实践给出了提高其可靠性的一有用办法和注意事项，如冗余设计、同步设计、自检等。表明配置信息
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基于FPGA的时统模块可靠性设计
摘要：文章从FPGA逻辑编程设计技术、EMC技术、高速电路PCB设计技术等几个方面介绍了时统接收处理模块的抗干扰设计及其实现方法，实现了同步脉冲的提取、对时功能、自守时、脉宽调制等功能，提高了同步精度和抗干扰性
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赛灵思推出Virtex-7 FPGA系列首款产品
21ic讯 赛灵思公司 （Xilinx, Inc.）日前宣布推出了 Virtex-7 现场可编程门阵列 (FPGA) 系列的首款产品。28nm Virtex-7系列产品旨在满足设备制造商的各种要求，帮助他们实现具有最高吞吐量的有线通信系统；最高信号处
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基于FPGA的出租车计费系统设计
摘要：出租车计费系统大多利用单片机进行控制，较易被改装，且故障率较高。针对这一问题，设计了一种基于FPGA的出租车计费系统，可模拟汽车行驶、暂停等待，停止等过程，并可同时显示金额、乘车总路程。设计采用层次
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基于TMS320C6455的视频动目标检测装置设计
摘要：介绍一种基于高速DSP芯片TMS320C6455构建的视频动目标检测装置，有效地利用6455的大容量内存空间等特点，采用EDMA功能实现了高速数据传输的乒乓缓冲结构设计，软件设计是基于背景更新的动目标检测算法，测试结
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基于FPGA的出租车计费系统设计
摘要：出租车计费系统大多利用单片机进行控制，较易被改装，且故障率较高。针对这一问题，设计了一种基于FPGA的出租车计费系统，可模拟汽车行驶、暂停等待，停止等过程，并可同时显示金额、乘车总路程。设计采用层次
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基于TMS320C6455的视频动目标检测装置设计
摘要：介绍一种基于高速DSP芯片TMS320C6455构建的视频动目标检测装置，有效地利用6455的大容量内存空间等特点，采用EDMA功能实现了高速数据传输的乒乓缓冲结构设计，软件设计是基于背景更新的动目标检测算法，测试结
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基于FPGA的IP核8051上实现TCP/IP的设计
该便携式接触网故障信号分析仪采用图形化程序设计语言LabVIEW开发设计, 可实现数据的高速实时采集、在线分析、自动存储、显示等功能。高速数字化仪NI PXI- 5112卡采样速度高、性能稳定可靠, 适宜对高速变化信号的实时监测。将软件安装在PXI- 1042工控机上, 具有体积小、抗干扰能力强、携带方便等特点, 同时具有故障性质判断、故障定位功能。该系统目前已经在石家庄变电所现场运行, 效果良好。
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基于FPGA的智能变送器的设计与实现
摘要：根据工业应用的实际需要以及网络通信发展的功能要求，提出了基于FPGA智能变送器控制系统的总体方案，设计了以XILINX公司的Spartan3系列XC3S4005PO208C可编程逻辑器件为主控制器、DM9000A为以太网通信接口、SJA
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FPGA控制下面阵CCD时序发生器设计及硬件实现
摘要 在分析Sony公司ICX098BQ面阵CCD图像传感器驱动时序的基础上，对可调节曝光时间的CCD时序发生器及其硬件电路进行设计。选用FPGA器件作为硬件设计平台，使用VHDL语言对时序关系进行了硬件描述。采用QuartusII 8.0
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播洒FPGA的种子 助力中国人才培养
Altera的2011亚洲创新设计大赛和电子设计文章竞赛正如火如荼地进行着，笔者有幸对其发起人、组织者－Altera公司大学计划中国地区项目总负责人徐平波先生进行了专访。徐平波先生虽已年过六旬，长期坚持游泳，神采奕奕
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基于FPGA的NAND Flash ECC校验
摘要 基于Flash存储器的Hamming编码原理，在Altera QuartusⅡ7．0开发环境下，实现ECC校验功能。测试结果表明，该程序可实现每256 Byte数据生成3 Byte的ECC校验数据，能够检测出1 bit错误和2 bit错误，对于1 bit错误
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FPGA控制下面阵CCD时序发生器设计及硬件实现
摘要 在分析Sony公司ICX098BQ面阵CCD图像传感器驱动时序的基础上，对可调节曝光时间的CCD时序发生器及其硬件电路进行设计。选用FPGA器件作为硬件设计平台，使用VHDL语言对时序关系进行了硬件描述。采用QuartusII 8.0
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FPGA时钟设计
摘要：在FPGA设计中，为了成功地操作，可靠的时钟是非常关键的。设计不良的时钟在极限的温度、电压下将导致错误的行为。在设计PLD／FPGA时通常采用如下四种类型时钟：全局时钟、门控时钟、多级逻辑时钟和波动式时钟。
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基于FPGA的自适应波束形成算法实现
1 引 言 在雷达及声纳信号处理系统中，波束形成算法通常采用DSP软件编程实现，控制逻辑电路采用CPLD来完成，这种方法具有软件编程灵活、功能易于扩展的优点，但对于实时性能要求很高的系统，如雷达、声纳探测和
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基于FPGA的实时中值滤波器硬件实现
针对高清图像在中值滤波预处理过程中排序量多、速度慢的特点，提出适合邻域图像并行处理机的分块存储方法。在流水线结构下，1个时钟周期可以并行处理32个3×3邻域的中值滤波运算，实现了高速、实时的1 920×1 080灰度图像中值滤波器。
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赛灵思ISE 13.2增加重置功能，提高28nm FPGA验证效率
可编程平台厂商赛灵思公司（Xilinx,Inc.）近日宣布推出最新版 ISE® 13.2 设计套件，为28nm 7系列产品，包括将于近期面世的Virtex-7 VX485T提供支持。同时，最新版本的ISE设计套件将采用堆叠硅片互联技术构建的业
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基于FPGA的自适应波束形成算法实现
1 引 言 在雷达及声纳信号处理系统中，波束形成算法通常采用DSP软件编程实现，控制逻辑电路采用CPLD来完成，这种方法具有软件编程灵活、功能易于扩展的优点，但对于实时性能要求很高的系统，如雷达、声纳探测和
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一种多路图像采集系统的软件设计
工业现场因为环境复杂，实时性要求高，常常需要对一处或多处重要位置同时进行监控，且能够在需要时切换其中一幅画面全屏显示。这就要求设计一种实时视频监控系统，既能够满足工业现场应用的特殊环境，具有体积小、功
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赛灵思推出最新版ISE® 13.2设计套件
21ic讯 赛灵思公司（Xilinx,Inc.)日前宣布推出最新版 ISE® 13.2 设计套件，为28nm 7系列产品，包括将于近期面世的Virtex-7 VX485T提供支持。同时，最新版本的ISE设计套件将采用堆叠硅片互联技术构建的业界最高密
