MIO EMIO 管脚的分配是怎么样的，PS和PL共同的MIO有哪些？
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MIO EMIO 管脚的分配是怎么样的，PS和PL共同的MIO有哪些？我们先看看两者的区别。
MIO
Zynq7000 系列芯片有54个MIO(multiuse I/O)，分配在GPIO的Bank0和Bank1部分，与PS端是直接相连的，所有属于PS部分，不需要添加任何的引脚约束。
并且MIO信号对PL部分是透明的，在对MIO的操作时候，可以看作是纯粹的PS端操作。
EMIO
Zynq可以配置最多63个EMIO引脚，被分配在Bank2和Bank3上，这些引脚可以配置到PL部分，也可以配置到外设的引脚上，不过这个时候需要添加约束文件指定封装引脚。
Diagram 中Processing_System_7_0ip的Block如下：
关于Zynq最主要的硬件手册为UG585 - Zynq-7000 SoC Technical Reference Manual
关于Zynq的软件开发手册为UG821 - Zynq-7000 All Programmable SoC Software Developers Guide
这些文档在VIVADO安装完成后会有一个DocNav
打开它会看到FPGA所有的相关文档。勾选项参见下图：
MIO为PS侧的通用外设接口
但是说是通用外设，实际上功能是有限制的只能连接ZYNQ支持的外设，例如下图：
zynq外接了SPI Flash 和 Eethernet控制器，当这两个外设被选择后，MIO[6:1]和MIO[27:16]就被占用了。在MIO Configuration页可以看到具体的分配关系，如下图：
硬件原理图按照这个管脚分配将对应MIO管脚连接相应的外设就可以了。
EMIO相对更灵活一些
除了Flash和USB外设不能选择EMIO，其它类型的外设都可以选择，在PL侧的外设管脚分配比较灵活，只要是通用IO管脚都可以分配。下图是将ETH1分配到EMIO（同时USB0占用了与ETH1共享的MIO管脚）的配置图：
在PL侧可以将Enet1对应的信号分配到任意IO管脚上，比MIO灵活许多，只受EMIO总数量的限制（64进64出64输出使能）。
MIO和EMIO不存在共同一说，53个MIO对应固定的53个专用管脚，EMIO的信号可以任意分配到PL侧的通用IO管脚上，只需要注意相应BANK的IO电压是否一致即可。
同一个外设(例如Enet1)同一时刻只能配置成连接MIO或EMIO，不能在运行时更改。关于MIO和EMIO的详细描述在UG585的2.5节中。
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