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FPGA（Field－Programmable Gate Array），即现场可编程门阵列，它是在PAL、GAL、CPLD等可编程器件的基础上进一步发展的产物。它是作为专用集成电路（ASIC）领域中的一种半定制电路而出现的，既解决了定制电路的不足，又克服了原有可编程器件门电路数有限的缺点。

基于FPGA与SRAM的大容量数据存储的设计

基于FPGA与SRAM的大容量数据存储的设计

嵌入式教程
2010-09-23

FPGA SRAM 数据存储 TIMES
基于FPGA控制的LED汉字滚动显示器设计

现了基于FPGA硬件及VHDL语言设计的LED点阵汉字滚动显示，可通过按键选择，控制其滚动方式：左移或者右移及上移或者下移等。阐述了LED点阵显示汉字的原理，给出了点阵汉字滚动显示控制器的原理图、部分VHDL源程序及时序仿真图并进行了详细的分析，提出了系统扩展成实现16×16点阵汉字滚动的改动思路。

电子设计自动化
2010-09-23

LED 显示器控制 FPGA
基于FPGA的三轴伺服控制器设计与实现

针对某机载三轴运动平台的高精度伺服控制要求，设计了基于FPGA的伺服控制器。重点对硬件中的控制模块、驱动模块、通信模块和软件中的中断、复位、A／D转换等子程序进行了设计与实现。尤其是在驱动模块设计中，详细探讨了力矩电机的反馈环节参数给定模式。通过后续的仿真测试，验证了该三轴伺服控制器的有效性。

电子设计自动化
2010-09-23

伺服控制器 BSP 控制器设计 FPGA
一种数字示波器的微处理器硬件设计

本设计有以下优点：数据处理与系统控制同步执行；微处理器内部存储资源丰富，且采用二级缓存结构，系统响应速度快；外设资源丰富，提供了如USB接口、RS232接口和以太网接口等与PC机互联的接口，方便示波器上采集到的波形数据在PC机上实时处理和在线调试；外部存储器资源丰富，采用1Gbit 容量的DDR2 SDRAM作后级波形数据缓存区和显示数据缓存区，能够存储更多波形数据，观察到更多波形细节。由此可见，采用该示波器系统可大幅提高数字示波器的数据处理能力和波形捕获率，整机的响应速度也将上一个台阶。

通信技术
2010-09-21

微处理器硬件设计数字示波器 FPGA
基于FPGA控制的LED汉字滚动显示器设计

现了基于FPGA硬件及VHDL语言设计的LED点阵汉字滚动显示，可通过按键选择，控制其滚动方式：左移或者右移及上移或者下移等。阐述了LED点阵显示汉字的原理，给出了点阵汉字滚动显示控制器的原理图、部分VHDL源程序及时序仿真图并进行了详细的分析，提出了系统扩展成实现16×16点阵汉字滚动的改动思路。

数字电源
2010-09-20

LED 显示器控制 FPGA
基于FPGA的三轴伺服控制器设计与实现

针对某机载三轴运动平台的高精度伺服控制要求，设计了基于FPGA的伺服控制器。重点对硬件中的控制模块、驱动模块、通信模块和软件中的中断、复位、A／D转换等子程序进行了设计与实现。尤其是在驱动模块设计中，详细探讨了力矩电机的反馈环节参数给定模式。通过后续的仿真测试，验证了该三轴伺服控制器的有效性。

数字电源
2010-09-20

伺服控制器 BSP 控制器设计 FPGA
数字音频广播（DAB）接收机的方案原理及设计思路

　本文将介绍数字音频广播（DAB）接收机的样机设计。　　系统的性能要求　　欧洲DAB系统规定了4种模式，本设计采用的是第1种模式，具体参数如表1所示。其中，L表示一帧的符号数，K表示每个符号的子载波个数，TF表示一

通信技术
2010-09-20

接收机数字音频 ADC FPGA
基于FPGA的DDS设计及实现

针对DDS频率转换时间短，分辨率高等优点，提出了基于FPGA芯片设计DDS系统的方案。该方案利用A1tera公司的QuartusⅡ开发软件，完成DDS核心部分即相位累加器和ROM查找表的设计，可得到相位连续、频率可变的信号，并通过单片机配置FPGA的E2PROM完成对DDS硬件的下载，最后完成每个模块与系统的时序仿真。经过电路设计和模块仿真，验证了设计的正确性。由于FPGA的可编程性，使得修改和优化DDS的功能非常快捷。

电子设计自动化
2010-09-20

相位 DDS BSP FPGA
基于FPGA的高速通信系统研究

介绍了以FPGA为核心基手LVDS接口的高速通信系统。系统通过FPGA将并行输入的信号组成特定的串行帧格式，并用LVDS接口发送。电缆驱动器及接收均衡器芯片用于加强系统远距离数据传送的能力，以保证200 m同轴电缆的数据传输。系统使用串行同步方式传输，接收端首先通过时钟恢复芯片从串行数据帧中提取同步时钟，然后接收串行数据帧并恢复原信号。系统灵活性强、稳定性高，单路传输逮度高达120 Mb／s。

通信技术
2010-09-20

系统研究 BSP 高速通信系统 FPGA
赛灵思与 VSofts 演示基于赛灵思 FPGA 的低延时实时 H.264/AVC-I IP 核压缩解决方案

赛灵思公司（Xilinx, Inc. (NASDAQ:XLNX) ）与Vanguard Software Solutions 公司 (VSofts) 在 IBC2010 大会上联合演示了 VSofts H.264/AVC-I IP 核的强大功能：能实现超低延时，且其现场可编程门阵列 (FPGA) 实施

消费电子
2010-09-19

赛灵思 IP AVC FPGA
Xilinx FPGA 开发平台助力广播设备制造商满足实时3D电视带宽与处理需求

全球可编程平台领导厂商赛灵思公司（Xilinx, Inc. (NASDAQ:XLNX) ）在 IBC 2010 展会上宣布推出一款全新开发平台，帮助工程师充分满足快速发展的3D电视广播与其它高清视频应用需求。赛灵思Spartan-6 FPGA 广播连

消费电子
2010-09-19

Xilinx 开发平台 3D电视 FPGA
Actel FPGA现可配合加密内核对抗DPA攻击

爱特公司(Actel CorporaTIon) 宣布其多种FPGA产品现可搭配使用加密内核，对抗差分功率分析(differential Power analysis, DPA)攻击。采用SmartFusion、Fusion、ProASIC3和 IGLOO的设计人员现可通过使用IP Cores公

消费电子
2010-09-19

加密内核 ACTEL FPGA
一种数字示波器的微处理器硬件设计

本设计有以下优点：数据处理与系统控制同步执行；微处理器内部存储资源丰富，且采用二级缓存结构，系统响应速度快；外设资源丰富，提供了如USB接口、RS232接口和以太网接口等与PC机互联的接口，方便示波器上采集到的波形数据在PC机上实时处理和在线调试；外部存储器资源丰富，采用1Gbit 容量的DDR2 SDRAM作后级波形数据缓存区和显示数据缓存区，能够存储更多波形数据，观察到更多波形细节。由此可见，采用该示波器系统可大幅提高数字示波器的数据处理能力和波形捕获率，整机的响应速度也将上一个台阶。

数字电源
2010-09-18

微处理器硬件设计数字示波器 FPGA
数字音频广播（DAB）接收机的方案原理及设计思路

　本文将介绍数字音频广播（DAB）接收机的样机设计。　　系统的性能要求　　欧洲DAB系统规定了4种模式，本设计采用的是第1种模式，具体参数如表1所示。其中，L表示一帧的符号数，K表示每个符号的子载波个数，TF表示一

数字电源
2010-09-18

接收机数字音频 ADC FPGA
易于在FPGA上实现的专业级音频编解码器（Xilinx&Coreworks）

赛灵思公司（Xilinx, Inc.）携手Coreworks在IBC 2010展会上推出业界首款采用 FPGA 技术压缩多通道音频的一系列全新 Dolby® 及其它音频编码解码器 IP核。由于在单个 FPGA 上可高度集成上述所有编解码器，因而无需

电子设计自动化
2010-09-17

Xilinx 音频编解码器 CORE FPGA
基于Java的FPGA可编程嵌入式系统

基于Java的FPGA可编程嵌入式系统

嵌入式教程
2010-09-17

嵌入式系统编程 JAVA FPGA
FPGA全局时钟资源相关原语及使用

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嵌入式教程
2010-09-17

时钟 IO DCM FPGA
Actel FPGA现可配合加密内核对抗DPA攻击

爱特公司(Actel Corporation) 宣布其多种FPGA产品现可搭配使用加密内核，对抗差分功率分析(differential power analysis, DPA)攻击。采用SmartFusion™、Fusion、ProASIC®3和 IGLOO®的设计人员现可通过

电子设计自动化
2010-09-16

加密内核 ACTEL FPGA
台积28奈米 Q4提前量产

台积电（2330）28奈米获得可程序逻辑芯片大厂阿尔特拉（Altera）视讯新产品采用，预计下季对用户提供参考设流程。台积电28奈米第四季将在新竹12厂第五期为客户量产，法人推估，第四季不排除有小量营收，较公司规划

模拟
2010-09-16

Altera 芯片台积电 FPGA
基于FPGA的雷达脉冲预分选器设计

现代电子战环境复杂，信号密度大，所以对信号的实时分选很重要。这里，提出一种基于关联比较器的雷达信号分选方法，在实现多参数分选的同时，也保证了实时性。详细阐述了在Virtex 4系列FPGA上实现基于内容可寻存储器(CAM)的关联比较器的途径。

电子设计自动化
2010-09-16

脉冲雷达 BSP FPGA

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