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[导读]相控阵天线的工作带宽从窄带迈向宽带,一个幽灵般的问题如影随形——波束倾斜。移相器在中心频率上完美工作,但频谱高端和低端的恒定相位偏移让波束指向随频率漂移,雷达图像模糊、通信链路衰减。True Time Delay(TTD,真时延)技术,正是斩断这条锁链的利刃。它不是对移相器的修补,而是对波束控制范式的根本革命。

相控阵天线的工作带宽从窄带迈向宽带,一个幽灵般的问题如影随形——波束倾斜。移相器在中心频率上完美工作,但频谱高端和低端的恒定相位偏移让波束指向随频率漂移,雷达图像模糊、通信链路衰减。True Time Delay(TTD,真时延)技术,正是斩断这条锁链的利刃。它不是对移相器的修补,而是对波束控制范式的根本革命。

一、设计原理:用时间换空间,以平坦换精准

相控阵波束指向由阵元间相位梯度决定:Δϕ=kd⋅sinθ0。窄带系统中,移相器提供的恒定相位差 Δϕ 即可精确控制波束。但在宽带系统中,移相器的相位偏移与频率无关,而波束指向所需的相位差却与频率成正比——这一矛盾直接导致孔径效应(Aperture Effect),即波束倾斜。

TTD的核心原理极其简洁:用真正的时间延迟 τ 替代等效相位偏移。由于 τ=ϕ/2πf,当时延恒定而非相位恒定时,相移与频率严格成正比,群延迟 τg=dϕ/dω 在整个带宽内保持平坦。这意味着频谱上每一个频率分量都被精确导向同一空间方向,波束倾斜从物理根源上被消除。

一个典型6位移相器的最低有效位(LSB)为5.625°,在10GHz频段约对应75ps时延。对于具有60°最大扫描角的16振子均匀线阵(ULA),系统总共需要约650ps的时间延迟覆盖。TTD单元正是通过多级比特位结构,以开关切换不同长度的传输线组合,精确合成所需时延。

二、设计选型:四条技术路线的博弈

TTD的实现并非只有一条路,工程选型本质上是带宽、损耗、面积与成本的四维权衡。

路线一:开关延时线(Switched Delay Line)。 最经典的架构,通过SPDT/DPDT开关在参考路径与多条不同长度的延时路径间切换,形成量化延迟。优点是噪声低、设计直观;缺点是随着延时位数增加,裸片尺寸急剧膨胀——基于开关的TTD设计有时比人工传输线方案大三倍。

路线二:人工传输线(ATL)。 用级联LC单元模拟传输线,通过抽头切换实现不同时延。2025年发表的SiGe BiCMOS方案即采用此路线:基于0.13μm工艺,工作频率覆盖2~18GHz(S波段至Ku波段),6位数字控制,最小延迟分辨率6ps,最大延迟378ps。芯片尺寸仅3mm×0.9mm,单位面积延迟密度高达141.6 ps/mm²,面积效率极为突出。

路线三:基于CMOS的集成TTD。 由TTD电路、数字步进式衰减器(ATT)、宽带分布式增益放大器(WDGA)和SPI接口四部分组成。ATT中的SPDT/DPDT开关与人工传输线配合实现延时,WDGA则补偿插入损耗。这种方案设计紧凑、成本低,是6GHz频段5G-A宏站的现实选择。

路线四:光纤与集成光延迟网络。 光纤TTD延迟时间易做长、体积小、不同延迟状态损耗均匀,特别适合大型阵列。美国NRL实验室已在GaAs芯片上实现11位集成光延迟网络,覆盖L波段60%以上带宽。但光电变换损耗仍是瓶颈。

选型决策的关键判据:若带宽超过10%且扫描角大于30°,TTD几乎是必选项;若追求极致面积效率,ATL路线领先;若系统已有光纤馈电架构,光TTD可无缝集成。

三、电路分析:参考路径与延时路径的精密博弈

一个典型的多比特TTD单元由三部分构成:开关网络、时延元件、均衡器。其核心是构建参考路径(Reference Path)与延时路径(Delay Path)的差分配对。

以T型和π型衰减器结构为例:延时参考路径与延时单元的增益曲线必须严格匹配,否则不同状态下的幅度不一致将直接恶化副瓣电平。均衡器(Equalizer)的作用正是在全频带内拉平时延响应——没有均衡器,ATL结构因人工传输线的固有色散,会在高频段引入显著的时延波动。

在子阵级馈电架构中,TTD被置于驱动级与子阵之间。发射时,信号经功率分配后进入各子阵TTD,获得精确时延后再经T/R组件功放辐射;接收时,LNA输出信号经TTD对齐时序后合成。由于AESA中每个T/R组件自带LNA,馈电网络的插入损耗不再是主导矛盾,这为采用损耗较高但面积更小的ATL结构打开了窗口。

时延精度直接决定波束质量。根据实测数据,上述SiGe BiCMOS TTD的全状态均方根延时误差小于5.9ps,在2.5V供电下全频段增益维持在-5.5~-1dB。这意味着在18GHz高端频率,时延误差引起的波束指向偏差可控制在0.1°以内——对于60°扫描范围的阵列,这是可以接受的工程精度。

四、性能数据:从纸面到现实的跨越

指标
开关延时线TTD
ATL(SiGe BiCMOS)
CMOS集成TTD
光TTD
工作带宽
5-15GHz
2-18GHz
3-6GHz
>60%相对带宽
延迟分辨率
15-30ps
6ps
10-20ps
2-4ps
最大延迟
500ps+
378ps
200ps
>10ns
芯片面积
大(开关型)
3×0.9mm²
中等
芯片级集成
插入损耗
3-5dB
5.5-1dB
4-6dB
光电变换损耗大
适用场景
军用雷达
5G-A/卫星通信
6GHz试验网
大型相控阵

数据不会说谎。当6GHz频段的5G-A宏站要求覆盖半径从420m拓展至890m、边缘速率从1.2Mbps跃升至8.6Mbps时,馈电网络中的TTD不再是可选项,而是决定上下行解耦传输能否成立的核心使能技术。

波束倾斜是宽带相控阵的原罪,TTD是它的救赎。从75ps的最小步进到650ps的系统总需求,从3mm²的芯片到覆盖S到Ku波段的全频谱——TTD馈电网络的每一个皮秒,都在丈量着相控阵天线从窄带走向宽带的距离。

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