应用
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准谐振反激式开关电源的设计方案
一种基于UCC28600控制器的准谐振反激式开关电源的设计方案，该方案分析了准谐振反激式开关电源的工作原理及实现方式，给出了电路及参数设计和选择过程，以及实际工作开关波形。
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单相全桥电压型PWM 整流器设计
开关电源整流电路普遍采用不可控二极管或相控晶闸管整流方式，直流侧采用大电容滤波，输入电流谐波含量大，功率因数低，造成了严重的电网污染和能源浪费。
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这些AI芯片创企想挑战英伟达，它们能成功吗？
受到AI浪潮的刺激，英伟达市值冲至2万亿美元。5月22日英伟达公布一季度财报，财报显示期内英伟达营收260.4亿美元，同比增长262%；净利148.8亿美元，同比增长628%。
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通用人工智能何时到来？李彦宏与马斯克有不同观点
特斯拉创始人埃隆·马斯克预测，比人类更聪明的通用人工智能(AGI)将会很快问世。但百度CEO李彦宏的观点更加审慎，他认为这种说法是不现实的。
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探秘EVSE，全面解析电动汽车供电设备
随着电动汽车（EV）的不断普及，了解电动汽车基础设施，特别是电动汽车供电设备（EVSE）或者说充电站，变得极其重要。本文解释了EVSE工作原理以及它对向电动汽车过渡的重要性。
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verilog语法-浅谈case casez casex
在rtl仿真中，有四种状态，分别是0、1、x(unknown values)和z(high-impedance values)。
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SoC设计入门 - APB协议
上一篇主要讲述了soc的骨架，crossbar互联网路。现在来讲soc的神经末梢，它们依附在骨架上，受和调控制，并将外部信息分享给核心以及其他成员。它是什么呢?
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SoC设计入门 - APB master设计（接口类基础思维）
大家不要以为APB的master和slave很简单，不需要了解。这是大错特错，为什么呢?
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IC设计：ram的应用-使用bitmap实现数据压缩
Bitmap是一种通过位映射来高效存储和查询数据的技术，它在处理大规模数据集时能够有效地节省内存空间。Bitmap技术特别适用于需要对大量数据进行存在性检查的场景，比如用户签到、页面访问等，它可以显著节省内存空间。
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SoC进阶 - AHB master设计
前两篇进阶文章主要讲述了AHB slave的核心内容，这篇来讲AHB lite master的设计。
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Vivado DDS IP核仿真
直接数字合成器(DDS)或数控振荡器(NCO)是许多数字通信系统中的重要部件。正交合成器用于构造数字下变频器和上变频器、解调器，并实现各种类型的调制方案，包括PSK(相移键控)、FSK(频移键控(frequency shift keying))和MSK(minimum shift keyed)。数字生成复数或实数正弦曲线采用查找表方案。
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PCIE定位：PCIe需要的debug设计
本文将以PCIe EP用户逻辑举例，描述PCIe可以添加哪些定位手段。如图所示，PCIe IP作为endpoint与RC对接，用户实现了应用逻辑，与PCIe IP进行交互，交互信号中data格式为TLP报文格式，且交互信号包含相应的控制信号，例如PCIe配置空间和IP相干的配置信号。
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IC设计：ram的折叠设计
在IC设计中，我们有时会使用深度很大，位宽很小的ram。例如深度为1024，位宽为4bit的ram。此类的ram有个明显的缺点：形状狭长，不利于布局布线、导致读写接口走线过长，不利于时序收敛。
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PCIe 定位：链路问题定位方法
当PCIe出现链路不稳定时，如何进行进行问题定位。本文描述的场景：EP PCIe 最高速率为gen4模式，ltssm状态机无法持续稳定在L0状态。
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IC设计：clock-gating的综合实现
在ASIC设计中，项目会期望设计将代码写成clk-gating风格，以便于DC综合时将寄存器综合成clk-gating结构，其目的是为了降低翻转功耗。因为当控制信号（vld_in)无效时，使用了clk-gating后的寄存器，其CK（clk）端口一直为0，因此不存在翻转，能够有效降低寄存器的翻转功耗和对应的时钟树的翻转功耗。如下所示：下图左侧是DC综合后的clk -gating结构图，使用了ICG模块进行时钟gating，被gating后的时钟连接到寄存器的CK端。右侧是没有被clk-gating的寄存器结构图。
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