[导读]晶圆代工业者GlobalFoundries与其EDA、IP供货商伙伴共同宣布,已经完成28纳米CMOS制程的数字设计流程验证;该制程命名为“超低功耗(superlowpower,SLP)”,包含闸优先(gate-first)的高介电金属闸极堆栈(high-kmetal
晶圆代工业者GlobalFoundries与其EDA、IP供货商伙伴共同宣布,已经完成28纳米CMOS制程的数字设计流程验证;该制程命名为“超低功耗(superlowpower,SLP)”,包含闸优先(gate-first)的高介电金属闸极堆栈(high-kmetalgatestack)。
GlobalFoundries表示,现可让客户生产已通过验证的28纳米设计,并可提供一系列包括合成(synthesis)、布线、验证与可制造性设计(DFM)在内的工具与设计解决方案;其EDA与IP包括Synopsys、Metor、Magma、Apache、Cadence与ARM。
此外GlobalFoundries声称,其设计流程包括进阶的设计规则检查(designrulechecking)──DRC+,采用二维的形状式样板比对法(shape-basedpattern-matching),能将厘清复杂制程问题的速度提升100倍,又不牺牲精确度。
据了解,Cadence已经利用自家工具完成该制程节点的一款内含数百万晶体管、面积尺寸仅9mm2的验证设计,包含高阶合成、低功耗、布线、DFM与验证;该设计将在2011上半年完成硅验证,而完整的28纳米设计、布局脚本,以及一系列建议解决方案白皮书、DFM,将可在第一季提供给客户。
Synopsys所提供的工具包括设计与实体验证应用的LynxDesignSystem与GalaxyImplementationPlatform;Mentor的方案则整合了Olympus与Calibre等布线及制造评估(manufacturingscoring)工具。此外Apache的设计解决方案,锁定关键性的功耗、噪声与可靠度等设计挑战;ARM则聚焦Artisan实体IP平台。
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