TI 发布45纳米芯片制造工艺

  日前，德州仪器 (TI) 发布了45纳米(nm)半导体制造工艺的细节，该工艺采用湿法光刻技术，可使每个硅片的芯片产出数量提高一倍，从而提高了工艺性能并降低了功耗。通过采用多种专有技术，TI将集成数百万晶体管的片上系统处理器的功能提升到新的水平，使性能提高30%，并同时降低40%的功耗。

  TI 在 45 纳米工艺中采用了 SmartReflex™ 电源与性能管理技术，将智能化的自适应硅芯片、电路设计以及有关软件结合在一起。在 SmartReflex 技术的基础之上，TI 采用系统级技术以扩展整个 45 纳米 SoC 设计的功能，其中包括自适应软硬件技术，该技术能够根据设备的工作状态、工作模式与过程以及温度变化情况，动态地控制电压、频率与功耗。

  全新工艺还支持具有革命性突破的 DRP™ 架构，以便于 TI 在单芯片无线解决方案上集成数字 RF 功能。这种 SoC 技术可实现无线传输与接收功能，这使 TI 能够通过其高效率的 CMOS 制造基础来降低整体系统成本与功耗，释放板级空间。TI 45 纳米设计库还包括其它集成选项，如电阻器、感应器与电容器等多种模拟组件，从而使原先独立的功能实现了进一步的 SoC 集成。

  TI 率先采用 193 纳米湿浸式光刻技术，实现了竞争对手的 45 纳米干式光刻技术所难以企及的高密度。193 纳米湿浸式设备能够实现更高的解析度与更小的器件体积，从而为面向新工艺的升级提供了最大的特性优势。193 纳米湿浸式设备的工作原理是在透镜与晶圆间加入薄薄的液体层，以简化更精细尺寸电路的曝光工艺。

  与前代工艺技术一样，TI 将提供多套 45 纳米解决方案，这些解决方案均针对不同最终产品或应用的要求而专门进行了优化。通过调节晶体管的栅极长度、阈值电压、栅极介电层厚度或偏置条件等方法，电路设计人员可通过多种途径，创建灵活的优化设计方案。

  TI 位于得克萨斯州达拉斯的 DMOS6 工厂将在其 300 毫米晶圆生产中导入 45纳米工艺。低功耗 ASIC 设计库将于今年年底上市，首款 SoC 产品样片将于 2007 年推出，首批量产时间定于 2008 年年中。

  TI 高级副总裁兼首席技术官 Hans Stork 博士指出：“例如在手机处理器与 DSP系统方面，TI凭借在芯片制造领域的实力将推出45纳米的低成本工艺技术，并同时兼顾了性能、功耗及晶体管密度等方面的问题。这使客户能尽早推出速度更快、体积更小、功耗更低的产品，TI不断通过高良率晶圆推出数百万芯片，在业界始终处于领先地位。”

  TI预计，45 纳米工艺与 SoC 集成功能将使消费者体验高达 30% 的设备速度提升，这意味着每秒更多视频帧，从而实现更佳的移动电话用户体验。此外，无线用户将可以享受到同时运行多个应用的好处，如运行3D游戏的同时与游戏伙伴们进行视频交流，还可以在后台收发电子邮件。其它预测显示，TI 45纳米SoC将使功耗降低40%，从而获得更长的视频播放时间，并把手机待机时间延长高达 30%。