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[导读]晶圆代工大厂台积电日前宣布,该公司客户美商巨积(LSI)使用台积电65奈米低功耗制程的降低功耗(PowerTrim)技术,有效减少下一世代产品的总漏电耗能达25%以上。台积电这项降低功耗的技术与服务获得Tela Innovations独


晶圆代工大厂台积电日前宣布,该公司客户美商巨积(LSI)使用台积电65奈米低功耗制程的降低功耗(PowerTrim)技术,有效减少下一世代产品的总漏电耗能达25%以上。台积电这项降低功耗的技术与服务获得Tela Innovations独家专利授权,是将设计技术与先进半导体制程巧妙整和的创新技术,能有效降低每个产品的漏电耗能。
降低功耗软件(PowerTrim Software)分析巨积公司的设计,并些微增加在对时序较不敏感的路径上的闸极长度,以代替本来的组件。而闸极长度的增加,将使漏电功耗成指数型的递减,是以这些细微的调整会有相当可观的影响。

美商巨积产品及测试工程暨网络组件处处长Norm Lawrence表示:「低功耗与高效能是我们产品成功的关键,藉由和台积电密切的合作并采用Tela Innovations的降低功耗技术,我们的产品减少了超过25%的漏电耗能,有效改善漏电的良率分布。」

台积电降低功耗服务藉由临界尺寸(Critical Dimension)的微调技术,分析产品设计,并在对时序较不敏感的路径上将闸极长度调整为合适的大小,同时有效节省对时序较不敏感的路径上的晶体管耗能,而不影响芯片的性能。

此闸极临界尺寸微调属于光学临近效应修正(Optical Proximity Correction)的一部分,并不影响组件或芯片尺寸。因此,降低功耗服务能在不影响芯片性能及尺寸下,有效的大幅降低漏电耗能,同时亦能大幅降低漏电耗能变异性,进而改善组件参数良率。

台积电降低功耗服务可与其他降低漏电的技术如multi-Vt cell libraries、reverse body biasing、 header/footer sleep switches、与voltage islands等相容,可进一步减少漏电并强化节能效果,较临介高压晶体管的表现为佳。




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