换个角度解析DSP芯片，DSP硬件设计注意事项介绍

今天，小编将在这篇文章中为大家带来DSPDSP、DSP硬件设计注意事项的有关报道，通过阅读这篇文章，大家可以对DSP具备清晰的认识，主要内容如下。

一、DSP芯片

DSP芯片自诞生以来得到了飞速发展，一方面得益于集成电路的发展，另一方面也得益于巨大的市场。在短短数十年时间里，DSP芯片已在通信、雷达、图像、军事、仪器、自动化、信号处理等众多领域得到广泛的应用。

DSP芯片具体是怎么用的呢?举个例子，DSP芯片用在工业机器人领域，相当于起着关节的作用，有了DSP的控制，机器人反应更迅速，行动更精准。工业机器人在工作中需要处理大量的数据，随着工业机器人的应用日益广泛和普及，DSP芯片在这方面的应用越来越多，重要性、经济性、实用性都会得到体现。

实际上，随着以大数据、云计算、物联网、人工智能为代表的信息技术产业规模不断增大，集成电路的需求量在上升，每年从国外进口的总额也在不断攀升。以DSP(数字信号处理器)芯片为例，其与CPU、GPU、FPGA(并称为四大战略型处理器芯片，被广泛应用于网络设备、电力电子、工业控制、智能家居等行业。但是目前我国DSP芯片的供应基本被国外垄断，国内DSP芯片设计厂商很少，国内产商仍需踏实努力。

从全球市场来看，目前DSP芯片公司，国外的主要为德州仪器、摩托罗拉、模拟器件、国内的主要是偏向军用的中国电科等。随着国家对芯片国产化的呼声越来越高，也是中国芯片企业在积累中冲破重重阻碍并脱颖而出的机会。

二、DSP硬件设计需要注意的事项

通过上面的介绍，想必大家对DSP芯片已经具备了初步的认识。在这部分，我们主要来了解一下在DSP硬件设计过程中，需要注意哪些内容。

以下是DSP硬件设计的一些注意事项，各位同仁可以参考。

(注意事项一)时钟电路选择原则

1，系统中要求多个不同频率的时钟信号时，首选可编程时钟芯片;

2，单一时钟信号时，选择晶体时钟电路;

3，多个同频时钟信号时，选择晶振;

4，尽量使用DSP片内的PLL，降低片外时钟频率，提高系统的稳定性;

5，C6000、C5510、C5409A、C5416、C5420、C5421和C5441等DSP片内无振荡电路，不能用晶体时钟电路;

6，VC5401、VC5402、VC5409和F281x等DSP时钟信号的电平为1.8V，建议采用晶体时钟电路

(注意事项二)未用的输入/输出引脚的处理

1，未用的输入引脚不能悬空不接，而应将它们上拉活下拉为固定的电平

1)关键的控制输入引脚，如Ready、Hold等，应固定接为适当的状态，Ready引脚应固定接为有效状态，Hold引脚应固定接为无效状态

2)无连接(NC)和保留(RSV)引脚，NC 引脚：除非特殊说明，这些引脚悬空不接，RSV引脚：应根据数据手册具体决定接还是不接

3)非关键的输入引脚，将它们上拉或下拉为固定的电平，以降低功耗

2，未用的输出引脚可以悬空不接

(注意事项三)为什么要片内RAM大的DSP效率高?

目前DSP发展的片内存储器RAM越来越大，要设计高效的DSP系统，就应该选择片内RAM较大的DSP。片内RAM同片外存储器相比，有以下优点：

1)片内RAM的速度较快，可以保证DSP无等待运行。

2)对于C2000/C3x/C5000系列，部分片内存储器可以在一个指令周期内访问两次，使得指令可以更加高效。

3)片内RAM运行稳定，不受外部的干扰影响，也不会干扰外部。

4)DSP片内多总线，在访问片内RAM时，不会影响其它总线的访问，效率较高。

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